半整数分频器的设计 请不要上传有版权争议的内容和木马病毒代码
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分频功放技术资料
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对外部输入的高频脉冲信号进行分频
对外部输入的高频脉冲信号进行分频，应用于FPGA/CPLD ....
这是我在ISP编程实验中独立编写的一个采用行为描述方式实现的分频器
这是我在ISP编程实验中独立编写的一个采用行为描述方式实现的分频器，通过两个并行进程对输入信号CLK进行8分频，占空比为1:7...
此程序实现的是任意进制的分频 进制的输入是任意选择的
此程序实现的是任意进制的分频 进制的输入是任意选择的...
基于FPGA的分频器,可以根据更改参数,实现不同倍数的分频.
基于FPGA的分频器,可以根据更改参数,实现不同倍数的分频....
很精典的一个分频程序
很精典的一个分频程序，里面不但可以调节频率的大小，还可以调节脉宽，脉频，欢迎大家下载。...
verilog语言 实现5分频程序
verilog语言 实现5分频程序...
在VHDL下实现锁相环的源码和说明文档.通常用于分频或倍频时进行相位锁定.
在VHDL下实现锁相环的源码和说明文档.通常用于分频或倍频时进行相位锁定....
奇数分频:2.2倍分频,其他任意奇数倍的分频可扩展得到.
奇数分频:2.2倍分频,其他任意奇数倍的分频可扩展得到....
利用计数器和分频器设计一个实时的时钟。一共需要1个模24计数器、2个模6计数器、2个模10计数器、一个生成1Hz的分频器和6个数码管解码器。最终用HEX5~HEX4显示小时（0~23）
利用计数器和分频器设计一个实时的时钟。一共需要1个模24计数器、2个模6计数器、2个模10计数器、一个生成1Hz的分频器和6个数码管解码器。最终用HEX5~HEX4显示小时（0~23），用HEX3~H...