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VHDL/FPGA/Verilog Verilog 黄金参考指南是Verilog 硬件描述语言及其语法语义合并以及将它应用到硬件设计的一个 简明的快速参考指南
Verilog 黄金参考指南是Verilog 硬件描述语言及其语法语义合并以及将它应用到硬件设计的一个
简明的快速参考指南
VHDL/FPGA/Verilog 本電子檔為 verilog cookbook,包含了通訊,影像,DSP等重要常用之verilog編碼,可作為工程師與初學者的參考手冊
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行业应用文档 介绍配置曼彻斯特编码器 译码器的VHDL和Verilog源代码
This application note provides a functional des cription of VHDL and Verilog source code for a
教程资料 Verilog实现的DDS正弦信号发生器和测频测相模块
Verilog实现的DDS正弦信号发生器和测频测相模块,DDS模块可产生两路频率和相位差均可预置调整的值正弦波,频率范围为20Hz-5MHz,相位范围为0°-359°,测量的数据通过引脚传输给单片机,单片机进行计算和显示。
VHDL/FPGA/Verilog 本文介绍了使用verilog语言进行硬件设计的一些基本技巧
本文介绍了使用verilog语言进行硬件设计的一些基本技巧
VHDL/FPGA/Verilog Verilog HDL 程序 双路脉冲发生器的代码 包含了键盘控制
Verilog HDL 程序
双路脉冲发生器的代码
包含了键盘控制,LED显示,脉冲发生,脉冲频率测量模块
是我自己写得,希望能对你有帮助,有问题可以mail:shaojunwu1@163.com
其他 推荐下载,verilog状态机实例.体现了流水线思想的应用
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其他书籍 很好的VERILOG入门教程!个人感觉比Philip Moorby那本容易看懂
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VHDL/FPGA/Verilog 这个是用VERILOG做的一个8位功能很弱的CPU
这个是用VERILOG做的一个8位功能很弱的CPU
VHDL/FPGA/Verilog verilog 编程 有测试文档 基于查表结构实现 离散余弦变换dct 来源:opencores
verilog 编程
有测试文档
基于查表结构实现 离散余弦变换dct
来源:opencores