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Verilog实现的DDS正弦信号发生器和测频测相模块
Verilog实现的DDS正弦信号发生器和测频测相模块
教程资料
1339 K
52 次下载
2013-08-28
资源详细信息
文件格式
RAR
文件大小
1339 K
资源分类
教程资料
上传者
jwl119
发布时间
2013-08-28 23:30
下载统计
52
次
所需积分
2 积分
Verilog实现的DDS正弦信号发生器和测频测相模块 - 资源详细说明
Verilog实现的DDS正弦信号发生器和测频测相模块,DDS模块可产生两路频率和相位差均可预置调整的值正弦波,频率范围为20Hz-5MHz,相位范围为0°-359°,测量的数据通过引脚传输给单片机,单片机进行计算和显示。
Verilog实现的DDS正弦信号发生器和测频测相模块 - 源码文件列表
本资源包含 100 个源码文件
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1
workonebeta.qsf
查看源码
2
adjust.v
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3
workonebeta.flow.rpt
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4
workonebeta.pof
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5
workonebeta.fit.smsg
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6
measure.v
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7
workonebeta.fit.rpt
查看源码
8
pll.v
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9
strobe.bsf
查看源码
10
workonebeta.tan.rpt
查看源码
11
workonebeta.fit.summary
查看源码
12
degree.mif
查看源码
13
frefindtable.v
查看源码
14
workonebeta.eda.rpt
查看源码
15
adjust.v.bak
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