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Verilog 的查询结果
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技术资料 SOPC中FPGAIP核配置方案
本论文首先介绍SOPC的发展、应用及IP核复用技术，在研究FPGA的配置流程和I2C数据总线协议的基础上提出了在SOPC系统中用I2C总线对FPGA进行配置的方案。接着采用自顶向下的IC设计方法，通过Verilog HDL语言编程设计了I2C的主...
技术资料 高速DSP串行外设接口设计
·摘要：  文章分析了DSP同步串行外设接口的整体结构,以及工作时钟与数据传榆的四种类型,具体讨论寄存器基本单元触发器的改进和利用Verilog语言设计同步串行外设接口的寄存器电路,且给出了寄存器写操作在TMS320LF2407芯片正常工作的仿真时序图.   ...
技术资料 GPS接收机相关器的电路设计
阐述了GPS 相关器的工作原理并用Verilog 硬件描述语言实现的GPS 数字相关器的全部设计,它由控制接口模块
和相关通道组成,并在Modelsim6. 0 下后仿真通过。该电路用Altera 的FPGA 实现,工作正常,性能可靠,完全可以达到GPS
接收机的工作要求,并可以采用VLSI 实现。 ...
技术资料 SystemVerilog语言简介,基本语法都有了
SystemVerilog 语言简介SystemVerilog是一种硬件描述和验证语言（HDVL），它基于IEEE 1364-2001Verilog硬件描述语言（HDL），并对其进行了扩展，包括扩充了C语言数据类型、结构、压缩和非压缩数组、接口、断言等等，这些都使得SystemVeri1og在一个更高的抽象层次上提高了设计建模的能力。SystemVerilog由Acce11era开发，它 ...
技术资料 DSP集成电路设计
Digital signal processor is a new type of structure and high—performance microprocessors，
especially suitable for signal processing，communications，voice processing，image／graphics，
military,instrumentation，automation，medical and household．DSP has achieved significant
progress as its powerfu ...
VHDL/FPGA/Verilog 课程设计要求设计并用FPGA实现一个数字频率计
课程设计要求设计并用FPGA实现一个数字频率计，具体设计要求如下： 测量频率范围： 10Hz～100KHz 精度： ΔF / F ≤ ±2 % 系统外部时钟： 1024Hz 测量波形： 方波 Vp-p ＝ 3～5 V 硬件设备：Altera Flex10K10 五位数码管 LED发光二极管 编程语言：Verilog HDL / VHDL ...
系统设计方案 本文首先讨论了以太网介质访问控制MAC的功能和工作过程。接着介绍了以太网MAC芯片的一种设计方案
本文首先讨论了以太网介质访问控制MAC的功能和工作过程。接着介绍了以太网MAC芯片的一种设计方案，对MAC的功能进行了逻辑划分。据此可以用Verilog HDL或VHDL来加以描述，并进一步用FPCA或ASIC来加以实现，也可做成以太网MAC核.
汇编语言 利用拨码开关为可编程器件输入读写命令和相应的地址、数据
利用拨码开关为可编程器件输入读写命令和相应的地址、数据，8051读入可编程器件设定的命令字并根据可编程器件的设置进行读写操作，读出来的数据通过P0输出给可编程器件，并由可编程器件控制七段数码管显示。(Verilog+单片机) ...
技术资料 Cadence 使用手册
本手册共分为三部分：第一部分分为四章，分别介绍 Cadence cdsSpice、virtuoso Editing、Diva 和 verilog。第二部分主要介绍 MEDICI。第三部分是附录部分，是对前两章的一个补充,并简要的介绍了寄生元件提取语句的语法。
技术资料 一种用于浮点DSP的流水线结构DMA设计
· 摘要：  本文提出了一种用于32位浮点DSP处理器的改进型DMA结构.采用两级数据流水线结构,外设与内部存储器的数据传输速率比原来提高了一倍.使用verilog HDL语言对其进行编码和仿真,仿真结果表明工作频率达到250MHz以上,满足设计要求.   ...