📄 config_dac.tan.rpt
字号:
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; main_state.DATA ; rd_data[1]~reg0 ; clk ; clk ; None ; None ; 1.633 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; main_state.DATA ; rd_data[2]~reg0 ; clk ; clk ; None ; None ; 1.633 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; main_state.DATA ; rd_data[3]~reg0 ; clk ; clk ; None ; None ; 1.633 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; main_state.DATA ; rd_data[4]~reg0 ; clk ; clk ; None ; None ; 1.633 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; main_state.DATA ; rd_data[5]~reg0 ; clk ; clk ; None ; None ; 1.633 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; main_state.DATA ; rd_data[6]~reg0 ; clk ; clk ; None ; None ; 1.633 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; main_state.DATA ; rd_data[7]~reg0 ; clk ; clk ; None ; None ; 1.633 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; bit_transfered[7] ; main_state.DATA ; clk ; clk ; None ; None ; 1.628 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; sck_count[0] ; data_to_send[0] ; clk ; clk ; None ; None ; 1.602 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; read_flag ; rd_data[0]~reg0 ; clk ; clk ; None ; None ; 1.595 ns ;
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; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; main_state.STOP ; spi_sck~reg0 ; clk ; clk ; None ; None ; 0.984 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; main_state.STOP ; main_state.IDLE ; clk ; clk ; None ; None ; 0.982 ns ;
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; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; bit_transfered[7] ; bit_transfered[8] ; clk ; clk ; None ; None ; 0.957 ns ;
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; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; data_to_send[1] ; data_to_send[2] ; clk ; clk ; None ; None ; 0.818 ns ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ;
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