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主芯片:Actel的FPGA030,Verilog语言,串口
主芯片:Actel的FPGA030,Verilog语言,串口发送和接收的例程
其他嵌入式/单片机内容
280 K
161 次下载
2013-11-27
资源详细信息
文件格式
RAR
文件大小
280 K
资源分类
其他嵌入式/单片机内容
上传者
libin2722
发布时间
2013-11-27 00:27
下载统计
161
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2 积分
主芯片:Actel的FPGA030,Verilog语言,串口发送和接收的例程 - 资源详细说明
主芯片:Actel的FPGA030,Verilog语言,串口发送和接收的例程,开发环境:LiberoIDE 8.5
主芯片:Actel的FPGA030,Verilog语言,串口发送和接收的例程 - 源码文件列表
本资源包含 46 个源码文件
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1
uart.prj
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2
project.lst
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3
viewdraw.ini
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4
smartgen.aws
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5
modelsim.ini
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6
modelsim.ini.sav
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7
uart_test.srs
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8
uart_test_srr.htm
查看源码
9
uart_test_toc.htm
查看源码
10
uart_test.msg
查看源码
11
uart_test.plg
查看源码
12
sap.log
查看源码
13
uart_test_flink.htm
查看源码
14
uart_test.srd
查看源码
15
traplog.tlg
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