modelsim.ini

来自「主芯片：Actel的FPGA030,Verilog语言,串口发送和接收的例程」· INI 代码 · 共 34 行

INI
34 行
字号 
[Library]
others = $MODEL_TECH/../modelsim.ini
proasic3 = D:/Libero/Designer/lib/modelsim/precompiled/vlog/proasic3























syncad_vhdl_lib = D:\Libero\Designer/lib/actel/syncad_vhdl_lib

[vcom]
VHDL93 = 1

[vsim]
IterationLimit = 5000

modelsim.ini - 源码说明

本页面展示了「主芯片：Actel的FPGA030,Verilog语言,串口发送和接收的例程」中的 modelsim.ini 源码文件，采用 INI 编程语言编写，共 34 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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