一个四位二进制加/减运算器。要求：当控制端G＝0时做加运算 - 免费下载

VHDL/FPGA/Verilog资源文件大小：220 K

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文件格式

RAR

所属分类

VHDL/FPGA/Verilog

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上传时间

2013-12-17 18:13

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220 K

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资源简介

一个四位二进制加/减运算器。要求：当控制端G＝0时做加运算，G＝1时做减运算。用发光二极管表示运算结果的正、负。用数码管显示运算结果：加运算时，相加之和不超过15，减运算时，结果可正可负，但都用原码表示。

源码文件列表

📂 共 96 个源码文件点击文件名可在线查看源代码

1 📄

subadd.root_partition.map.hdbx

2 📄

subadd.root_partition.cmp.hdbx

3 📄

subadd.root_partition.map.atm

4 📄

subadd.root_partition.cmp.atm

5 📄

subadd.root_partition.cmp.kpt

大小: 341 B

6 📄

subadd.root_partition.cmp.logdb

大小: 4 B

7 📄

subadd.root_partition.cmp.rcf

8 📄

subadd.root_partition.map.kpt

大小: 340 B

9 📄

subadd.root_partition.cmp.dfp

10 📄

subadd.root_partition.map.dpi

11 📄

readme

大小: 653 B

12 📄

subadd.fit.rpt

大小: 64 KB

13 📄

subadd.tan.summary

大小: 711 B

14 📄

subadd.qpf

大小: 907 B

15 📄

subadd.sim.rpt

大小: 11.97 KB

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#二进制 #减 #运算器 #控制

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