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一个基于VerilogHDL语言的16位的booth算法的乘
一个基于VerilogHDL语言的16位的booth算法的乘法器及其测试代码
VHDL/FPGA/Verilog
2 K
137 次下载
2014-01-18
资源详细信息
文件格式
RAR
文件大小
2 K
资源分类
VHDL/FPGA/Verilog
上传者
dan_che
发布时间
2014-01-18 13:41
下载统计
137
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2 积分
一个基于VerilogHDL语言的16位的booth算法的乘法器及其测试代码 - 资源详细说明
一个基于VerilogHDL语言的16位的booth算法的乘法器及其测试代码
一个基于VerilogHDL语言的16位的booth算法的乘法器及其测试代码 - 源码文件列表
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