用于verlilog自动产生testbench的脚本用法：gen_tb <yourfilename> - 免费下载

VHDL/FPGA/Verilog资源文件大小：3 K

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文件格式

未知

所属分类

VHDL/FPGA/Verilog

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上传时间

2014-01-23 17:33

文件大小

3 K

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⭐⭐⭐⭐⭐ (5/5)

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资源简介

用于verlilog自动产生testbench的脚本用法：gen_tb <yourfilename>

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gen_tb

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