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DDR（双速率）SDRAM控制器参考设计verilog代码

VHDL/FPGA/Verilog 736 K 122 次下载 2016-10-26

资源详细信息

文件格式

RAR

文件大小

736 K

资源分类

VHDL/FPGA/Verilog

上传者

发布时间

2016-10-26 20:35

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122 次

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2 积分

DDR（双速率）SDRAM控制器参考设计verilog代码 - 资源详细说明

DDR（双速率）SDRAM控制器参考设计verilog代码，可以直接用的，很好的

DDR（双速率）SDRAM控制器参考设计verilog代码 - 源码文件列表

本资源包含 61 个源码文件支持在线预览，点击文件名即可查看

1

readme.txt

2

mt46v4m16.v

3

pll1.v

4

ddr_sdram.esf

5

ddr_sdram.csf

6

ddr_sdram.vqm

7

ddr_sdram.quartus

8

ddr_sdram.psf

9

_primary.dat

10

_primary.vhd

11

verilog.psm

12

_primary.dat

13

_primary.vhd

14

verilog.psm

15

_info

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