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HDLC控制接收数据开始标志7E和去零模块
HDLC控制接收数据开始标志7E和去零模块
VHDL/FPGA/Verilog
3 K
71 次下载
2016-08-17
资源详细信息
文件格式
RAR
文件大小
3 K
资源分类
VHDL/FPGA/Verilog
上传者
wodn76
发布时间
2016-08-17 00:29
下载统计
71
次
所需积分
2 积分
HDLC控制接收数据开始标志7E和去零模块 - 资源详细说明
HDLC控制接收数据开始标志7E和去零模块,用于FPGA与E1相接,Verilog HDL语言编写
HDLC控制接收数据开始标志7E和去零模块 - 源码文件列表
本资源包含 1 个源码文件
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1
rece_7e.v
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