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采用vhdl语言编写的UP3开发板电子钟程序。在quartu
采用vhdl语言编写的UP3开发板电子钟程序。在quartus中编译完成。
VHDL/FPGA/Verilog
69 K
82 次下载
2014-01-10
资源详细信息
文件格式
RAR
文件大小
69 K
资源分类
VHDL/FPGA/Verilog
上传者
kens
发布时间
2014-01-10 10:18
下载统计
82
次
所需积分
2 积分
采用vhdl语言编写的UP3开发板电子钟程序。在quartus中编译完成。 - 资源详细说明
采用vhdl语言编写的UP3开发板电子钟程序。在quartus中编译完成。
采用vhdl语言编写的UP3开发板电子钟程序。在quartus中编译完成。 - 源码文件列表
本资源包含 18 个源码文件
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1
up3_clock.vhd
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2
up3_clock.done
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3
up3_clock.qsf
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4
up3_clock.fit.smsg
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5
up3_clock.fit.summary
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6
up3_clock.pof
查看源码
7
up3_clock.asm.rpt
查看源码
8
up3_clock.qpf
查看源码
9
up3_clock.flow.rpt
查看源码
10
up3_clock.sof
查看源码
11
up3_clock.pin
查看源码
12
up3_clock.tan.rpt
查看源码
13
up3_clock.dpf
查看源码
14
up3_clock.tan.summary
查看源码
15
up3_clock.fit.rpt
查看源码
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