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VHDL/FPGA/Verilog
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原创:采用VHDL语言编写的正弦信号发生器。rom采用qua
原创:采用VHDL语言编写的正弦信号发生器。rom采用quartus自带的lpm生成
VHDL/FPGA/Verilog
661 K
193 次下载
2014-06-19
资源详细信息
文件格式
RAR
文件大小
661 K
资源分类
VHDL/FPGA/Verilog
上传者
jzp_home_2009
发布时间
2014-06-19 23:59
下载统计
193
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2 积分
原创:采用VHDL语言编写的正弦信号发生器。rom采用quartus自带的lpm生成 - 资源详细说明
原创:采用VHDL语言编写的正弦信号发生器。rom采用quartus自带的lpm生成,可产生正弦波。更改rom内容可改变波形
原创:采用VHDL语言编写的正弦信号发生器。rom采用quartus自带的lpm生成 - 源码文件列表
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1
sine.tan.talkback.xml
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2
sine.map.talkback.xml
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3
sine.asm.talkback.xml
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4
sine.sim.talkback.xml
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5
sine.fit.talkback.xml
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6
sine.rpp.talkback.xml
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7
sine.qsf
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8
sine.qpf
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9
rom1_inst.vhd
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10
rom1.vwf
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11
sine.map.rpt
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12
sdata.hex
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13
sine.done
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14
sine.pin
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15
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