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VHDL/FPGA/Verilog
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用VERILOG语言实现了J-K触发器,可综合可仿真通过
用VERILOG语言实现了J-K触发器,可综合可仿真通过
VHDL/FPGA/Verilog
75 K
194 次下载
2014-01-25
资源详细信息
文件格式
RAR
文件大小
75 K
资源分类
VHDL/FPGA/Verilog
上传者
dtlyzx
发布时间
2014-01-25 03:49
下载统计
194
次
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2 积分
用VERILOG语言实现了J-K触发器,可综合可仿真通过 - 资源详细说明
用VERILOG语言实现了J-K触发器,可综合可仿真通过
用VERILOG语言实现了J-K触发器,可综合可仿真通过 - 源码文件列表
本资源包含 56 个源码文件
支持在线预览,点击文件名即可查看
1
jk_ff.fit.summary
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2
jk_ff.sim.rpt
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3
jk_ff.asm.rpt
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4
jk_ff.flow.rpt
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5
jk_ff.tan.rpt
查看源码
6
jk_ff.vwf
查看源码
7
jk_ff.v
查看源码
8
jk_ff.tan.summary
查看源码
9
jk_ff.map.eqn
查看源码
10
jk_ff.map.rpt
查看源码
11
jk_ff.fit.rpt
查看源码
12
jk_ff.map.summary
查看源码
13
jk_ff.qsf
查看源码
14
jk_ff.qpf
查看源码
15
jk_ff.done
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