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Xilinx DDR2存储器接口调试代码

VHDL/FPGA/Verilog 3312 K 124 次下载 2016-06-27

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3312 K

资源分类

VHDL/FPGA/Verilog

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发布时间

2016-06-27 20:40

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Xilinx DDR2存储器接口调试代码 - 资源详细说明

Xilinx DDR2存储器接口调试代码，主频167Mhz，嵌入了CHIPSCORP代码。

Xilinx DDR2存储器接口调试代码 - 源码文件列表

本资源包含 100 个源码文件支持在线预览，点击文件名即可查看

1

ddr2_32mx32_wr_gray_cntr.v

2

ddr2_32mx32_tap_dly.v

3

ddr2_32mx32_controller_iobs_0.v

4

ddr2_32mx32_fifo_0_wr_en_0.v

5

ddr2_32mx32_data_path_0.v

6

ddr2_32mx32_infrastructure_top_0.v

7

ddr2_32mx32_rd_gray_cntr.v

8

ddr2_32mx32_iobs_0.v

9

ddr2_32mx32_data_read_controller_0.v

10

ddr2_32mx32_cal_top.v

11

ddr2_32mx32_s3_dq_iob.v

12

ddr2_32mx32_cal_ctl_0.v

13

ddr2_32mx32_top_0.v

14

ddr2_32mx32_fifo_1_wr_en_0.v

15

ddr2_32mx32_parameters_0.v

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