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VHDL/FPGA/Verilog
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6端口寄存器IP内核VHDL源代码
6端口寄存器IP内核VHDL源代码
VHDL/FPGA/Verilog
29 K
146 次下载
2016-03-14
资源详细信息
文件格式
ZIP
文件大小
29 K
资源分类
VHDL/FPGA/Verilog
上传者
xinlanwj1226
发布时间
2016-03-14 10:07
下载统计
146
次
所需积分
2 积分
6端口寄存器IP内核VHDL源代码 - 资源详细说明
6端口寄存器IP内核VHDL源代码,所需的开发环境是QUARTUS II 6.0。
6端口寄存器IP内核VHDL源代码 - 源码文件列表
本资源包含 33 个源码文件
支持在线预览,点击文件名即可查看
1
copyright.txt
查看源码
2
integer_class.bdy
查看源码
3
integer_plus.bdy
查看源码
4
reg_file_32_8_6port.dec
查看源码
5
d_latch.dec
查看源码
6
std_logic_plus.pkg
查看源码
7
std_logic_plus.bdy
查看源码
8
6port_register_file.txt
查看源码
9
d_latch.ent
查看源码
10
std_logic_class.pkg
查看源码
11
reg_file_32_8_6port.arch
查看源码
12
string_plus.pkg
查看源码
13
demux_generic.arch
查看源码
14
vfp.cmp
查看源码
15
reg_file_class.pkg
查看源码
查看完整源码列表 (共 33 个文件) →
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