数字示波器的FPGA实现 VHDL编写 Quartus7.1测试通过 - 免费下载

VHDL/FPGA/Verilog资源文件大小：2192 K

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文件格式

RAR

所属分类

VHDL/FPGA/Verilog

上传用户

lilacky

上传时间

2013-11-28 12:44

文件大小

2192 K

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数字示波器的FPGA实现 VHDL编写 Quartus7.1测试通过

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📂 共 411 个源码文件点击文件名可在线查看源代码

1 📃

Ŀ¼.txt

大小: 55 B

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2 📄

fredevider8.bsf

大小: 2.18 KB

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3 📄

大小: 2.92 KB

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4 📄

dmux.cmp

大小: 1.62 KB

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5 📄

generator_reg81.vhd

大小: 945 B

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6 📄

dram.cmp

大小: 1.73 KB

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7 📄

voltage_conv.vhd

大小: 1.09 KB

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8 📄

test_ad.bdf

大小: 38.5 KB

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9 📄

mux2_3.vhd

大小: 395 B

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10 📄

dram.vhd

大小: 9.46 KB

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scanwave.map.summary

大小: 322 B

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edge.vhd

大小: 448 B

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13 📄

scanwave_assignment_defaults.qdf

大小: 28.67 KB

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scanwave.map.eqn

大小: 64 KB

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15 📄

scanwave.pof

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