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Viterbi算法的Verilog源代码。

VHDL/FPGA/Verilog 12 K 94 次下载 2014-01-07

资源详细信息

文件格式

RAR

文件大小

12 K

资源分类

VHDL/FPGA/Verilog

上传者

发布时间

2014-01-07 20:09

下载统计

94 次

所需积分

2 积分

Viterbi算法的Verilog源代码。 - 资源详细说明

Viterbi算法的Verilog源代码。

Viterbi算法的Verilog源代码。 - 源码文件列表

本资源包含 12 个源码文件支持在线预览，点击文件名即可查看

1

system.v

2

spusnoop.v

3

chip_snoop.v

4

controller.v

5

_desktop.ini

6

acs4.v

7

acs1.v

8

chip_core.v

9

data_snoop.v

10

spu.v

11

controller_snoop.v

12

clkgen.v

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