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VHDL/FPGA/Verilog
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44个vhdl实例 注1: 含有不可综合语句
44个vhdl实例 注1: 含有不可综合语句
VHDL/FPGA/Verilog
44 K
38 次下载
2013-11-29
资源详细信息
文件格式
RAR
文件大小
44 K
资源分类
VHDL/FPGA/Verilog
上传者
asd66335065
发布时间
2013-11-29 08:36
下载统计
38
次
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44个vhdl实例 注1: 含有不可综合语句 - 资源详细说明
44个vhdl实例 注1: 含有不可综合语句,请自行修改 注2: 一些PLD只允许I/O口对外三态,不支持内部三态,使用时要注意 注3: 设计RAM的最好方法是利用器件厂家提供的软件自动生成RAM元件,并在VHDL程序中例化
44个vhdl实例 注1: 含有不可综合语句 - 源码文件列表
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