基于verilog hdl的UART串口发送子程序。 - 免费下载

VHDL/FPGA/Verilog资源文件大小：242 K

📋 资源详细信息

文件格式

RAR

所属分类

VHDL/FPGA/Verilog

上传用户

上传时间

2017-09-24 00:13

文件大小

242 K

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⭐⭐⭐⭐⭐ (5/5)

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资源简介

基于verilog hdl的UART串口发送子程序。

源码文件列表

📂 共 109 个源码文件点击文件名可在线查看源代码

1 📄

uart_txd.root_partition.cmp.dfp

2 📄

uart_txd.root_partition.map.dpi

3 📄

uart_txd.root_partition.map.hdbx

4 📄

uart_txd.root_partition.cmp.atm

5 📄

uart_txd.root_partition.map.atm

6 📄

uart_txd.root_partition.cmp.rcf

7 📄

uart_txd.root_partition.map.kpt

大小: 742 B

8 📄

uart_txd.root_partition.cmp.hdbx

9 📄

uart_txd.root_partition.cmp.kpt

大小: 341 B

10 📄

uart_txd.root_partition.cmp.logdb

大小: 4 B

11 📄

readme

大小: 653 B

12 📄

uart.mpf

大小: 12.03 KB

13 📄

_primary.dbs

14 📄

_primary.dat

15 📄

_primary.vhd

大小: 313 B

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#verilog #UART #hdl #串口发送

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