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用verilog HDL编写的基于fpga的动态数码管显示程序。

VHDL/FPGA/Verilog 4 K 162 次下载 2017-07-09

资源详细信息

文件格式

RAR

文件大小

4 K

资源分类

VHDL/FPGA/Verilog

上传者

发布时间

2017-07-09 20:28

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162 次

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用verilog HDL编写的基于fpga的动态数码管显示程序。 - 资源详细说明

用verilog HDL编写的基于fpga的动态数码管显示程序。

用verilog HDL编写的基于fpga的动态数码管显示程序。 - 源码文件列表

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1

bin_27_seg.v

2

fenpin_256.v

3

dtsmg.v

4

dtsmgxs.bdf

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