欢迎来到虫虫开发者社区 — 百万工程师技术资源
关于我们
网站地图
登录
注册
虫
虫虫开发者社区
首页
资源下载
资源专辑
热门软件
精品资源
电子书
上传资源
首页
›
资源下载
›
VHDL/FPGA/Verilog
›
用VHDL语言采用串行方法实现用1位全加器实现4位全加器
用VHDL语言采用串行方法实现用1位全加器实现4位全加器
VHDL/FPGA/Verilog
192 K
86 次下载
2016-05-27
资源详细信息
文件格式
RAR
文件大小
192 K
资源分类
VHDL/FPGA/Verilog
上传者
zm250063191
发布时间
2016-05-27 10:15
下载统计
86
次
所需积分
2 积分
用VHDL语言采用串行方法实现用1位全加器实现4位全加器 - 资源详细说明
用VHDL语言采用串行方法实现用1位全加器实现4位全加器
用VHDL语言采用串行方法实现用1位全加器实现4位全加器 - 源码文件列表
本资源包含 100 个源码文件
支持在线预览,点击文件名即可查看
1
onebitadder.fit.summary
查看源码
2
onebitadder.qsf
查看源码
3
fourbitadder.map.summary
查看源码
4
onebitadder.pof
查看源码
5
onebitadder.flow.rpt
查看源码
6
onebitadder.qpf
查看源码
7
fourbitadder.qws
查看源码
8
fourbitadder.done
查看源码
9
fourbitadder.tan.rpt
查看源码
10
onebitadder.tan.summary
查看源码
11
onebitadder.dpf
查看源码
12
fourbitadder.flow.rpt
查看源码
13
onebitadder.vwf
查看源码
14
onebitadder.tan.rpt
查看源码
15
onebitadder.sof
查看源码
查看完整源码列表 (共 100 个文件) →
温馨提示:
点击文件名或"查看源码"按钮可在线浏览源代码,支持语法高亮显示。
立即下载 用VHDL语言采用串行方法实现用1位全加器实现4位全加器
立即下载
提示:下载后请用压缩软件解压,推荐使用 WinRAR 或 7-Zip
下载说明与使用指南
下载说明
本资源需消耗
2积分
24小时内重复下载不扣分
支持断点续传功能
资源永久有效可用
使用说明
下载后使用解压软件解压
推荐使用 WinRAR 或 7-Zip
如有密码请查看资源说明
解压后即可正常使用
积分获取方式
上传优质资源获得积分
每日签到免费领取积分
邀请好友注册获得奖励
查看详情 →
相关技术标签
点击标签浏览更多相关VHDL/FPGA/Verilog资源:
#VHDL
#FPGA
#数字逻辑
相关VHDL/FPGA/Verilog资源推荐
1
用
VHDL
语言采用串行方法实现用1位全加器实现4位全加器
用VHDL语言采用串行方法实现用1位全加器实现4位全加器...
2016-05-27
86 次
1259 浏览
2
通过
VHDL
实现4位全加器
通过VHDL实现4位全加器,8位全加器,和8位通用寄存器的设计...
2014-01-11
187 次
1076 浏览
3
VHDL
实现四位全加器
VHDL实现四位全加器,适合初学者,源程序下载...
2013-12-30
87 次
1078 浏览
4
用
VHDL
语言实现4位乘法器
用VHDL语言实现4位乘法器,已被测试过,可参考使用...
2017-07-09
120 次
1122 浏览
5
运用
VHDL
语言实现四位超前进位加法器。
运用VHDL语言实现四位超前进位加法器。...
2017-07-18
54 次
1686 浏览
6
Quartus2实现的四位进制并行加法器 用
VHDL
语言实现
Quartus2实现的四位进制并行加法器 用VHDL语言实现...
2016-05-30
196 次
1594 浏览
7
用
VHDL
语言设计四位全加器
用VHDL语言设计四位全加器,有低位进位和高位进位。...
2013-12-26
132 次
1477 浏览
8
C语言4位全加器
基于C语言实现的4位全加器逻辑,支持按键控制LED与数码管显示。采用模块化设计,融合SOPC架构思想,具备良好的可移植性与扩展性。...
2026-02-25
1 次
45 浏览
9
四位全加器的
VHDL
与VerilogHDL实现
能对两个1位二进制数进行相加而求得和及进位的逻辑电路称为半加器。或:只考虑两个一位二进制数的相加,而不考虑来自低位进位数的运算电路,称为半加器。图1为半加器的方框图。图2为半加器原理图。其中:A、B分...
2025-04-01
10 次
2513 浏览
10
这是用
VHDL
实现的8位加法器
这是用VHDL实现的8位加法器,对新手有点帮助。...
2014-01-05
119 次
1145 浏览
用户登录
登录后可下载更多技术资源
×
加载中...
加载登录表单中...
用户注册
送10积分
加入工程师资源平台
×
加载中...
加载注册表单中...
找回密码
通过邮箱重置您的账号密码
×
加载中...
加载表单中...
需要登录
登录后即可使用更多功能
×
新用户注册即送10积分,可用于下载资源
👋
退出登录
确认要退出当前账号吗?
×
退出后需要重新登录才能下载资源