设计一个可编程间隔定时器 - 免费下载

VHDL/FPGA/Verilog资源 文件大小：7 K

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VHDL/FPGA/Verilog
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设计一个可编程间隔定时器，完成8253的功能，实现以下几点要求： 1、 含有3个独立的16位计数器，能够进行3个16位的独立计数。 2、 每一种计数器具有六种工作模式。 3、 能进行二进制/十进制减法计数。 4、 可作定时器或计数器。

源码文件列表

📂 共 6 个源码文件 点击文件名可在线查看源代码

1 📄
c8253.v
大小: 6.35 KB
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2 📄
logic.v
大小: 7.66 KB
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3 📄
counter.v
大小: 10.21 KB
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4 📄
buffer.v
大小: 2.38 KB
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5 📄
tb_8253.v
大小: 6.27 KB
查看源码
6 📄
control.v
大小: 5.7 KB
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