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vhdl的一个串行序列信号发生器的设计与实现
vhdl的一个串行序列信号发生器的设计与实现
VHDL/FPGA/Verilog
154 K
196 次下载
2015-07-15
资源详细信息
文件格式
压缩包
文件大小
154 K
资源分类
VHDL/FPGA/Verilog
上传者
zwendong
发布时间
2015-07-15 20:38
下载统计
196
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2 积分
vhdl的一个串行序列信号发生器的设计与实现 - 资源详细说明
vhdl的一个串行序列信号发生器的设计与实现
vhdl的一个串行序列信号发生器的设计与实现 - 源码文件列表
本资源包含 83 个源码文件
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1
produce.fit.summary
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produce.qpf
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3
produce.sim.rpt
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4
produce.fit.rpt
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5
produce.done
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6
produce.fit.eqn
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7
produce.map.rpt
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8
produce.vwf
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9
produce.map.summary
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10
produce.flow.rpt
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11
produce.pof
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12
produce.asm.rpt
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13
produce.tan.summary
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14
produce.vhd
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15
produce.cdf
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