伪随机序列发生器的vhdl算法 设计一个伪随机序列发生器

资 源 简 介

伪随机序列发生器的vhdl算法 设计一个伪随机序列发生器，采用的生成多项式为1+X^3+X^7。要求具有一个RESET端和两个控制端来调整寄存器初值（程序中设定好四种非零初值可选）

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