💻 基于地址总线接口的四倍频编码器信号接口的 FPGA实现 Verilog HDL的 - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 qep_data_bus.sim.rpt
4.22 KB
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2
📄 qep_data_bus.fit.summary
406 B
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3
📄 clk_gen.v
823 B
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4
📄 qep_data_bus.qsf
6.39 KB
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5
📄 qep_data_bus.vwf
58.31 KB
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6
📄 io_port.v
1.75 KB
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7
📄 qep_data_bus_debug.stp
14.02 KB
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8
📄 qep4.v
1.46 KB
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9
📄 test.ptf.bak
670 B
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10
📄 qep_data_bus.pin
18.22 KB
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11
📄 qep_data_bus.sof
0 B
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12
📃 serv_req_info.txt
3.78 KB
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13
📄 qep_data_bus.cdf
299 B
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14
📄 clk_4.v
734 B
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15
📄 qep_data_bus.tan.rpt
64 KB
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16
📄 qep_data_bus.qws
4.78 KB
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17
📄 data_bus.v
3.17 KB
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18
📄 pwm_gen.v
6.26 KB
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19
📄 leospec.his
788 B
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20
📄 disp.v
3.08 KB
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21
📄 qep_data_bus.done
26 B
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22
📄 qep_data_bus.fld
85 B
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23
📄 qep_data_bus.flow.rpt
3.52 KB
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24
📄 qep_data_bus.pof
0 B
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25
📄 qep_data_bus.fit.eqn
64 KB
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26
📄 qep_data_bus.edf
64 KB
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27
📄 qep_data_bus.asm.rpt
7.55 KB
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28
📄 qep_data_bus.sum
30.79 KB
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29
📄 cnt_pulse.v
1.19 KB
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30
📄 qep_data_bus.map.rpt
64 KB
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31
📄 qep_data_bus.tcl
1.57 KB
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32
📄 test.v
85 B
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33
📄 data_bus_bak1115.v
5.14 KB
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34
📄 qep_data_bus.map.eqn
64 KB
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35
📄 qep_data_bus.ppl
0 B
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36
📄 qep_data_bus.qpf
951 B
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37
📄 qep_data_bus.tan.summary
2.13 KB
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38
📄 qep_data_bus.map.summary
357 B
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39
📄 qep_data_bus.(25).cnf.hdb
0 B
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40
📄 qep_data_bus.sld_design_entry.sci
0 B
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41
📄 qep_data_bus.pre_map.cdb
0 B
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42
📄 qep_data_bus.(10).cnf.hdb
0 B
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43
📄 qep_data_bus.(27).cnf.hdb
0 B
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44
📄 qep_data_bus.(23).cnf.cdb
0 B
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45
📄 qep_data_bus.(14).cnf.hdb
0 B
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46
📄 qep_data_bus.sgate.rvd
0 B
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47
📄 qep_data_bus.cmp0.ddb
0 B
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48
📄 qep_data_bus.(7).cnf.cdb
0 B
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49
📄 qep_data_bus.(21).cnf.cdb
0 B
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50
📝 qep_data_bus.cbx.xml
814 B
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