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本文档主要是以Altera公司的Stratix II系列的FPGA器件为例，介绍了其内嵌的增强型可重配置PLL在不同的输入时钟频率之间的动态适应，其目的是通过提供PLL的重配置功能，使得不需要对FPG...

📅 2013-11-02

LC72131 PLL C源程序...

📅 2014-01-02

BU2614 PLL 源程序,直接解压...

📅 2015-03-07

PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿...

📅 2014-06-09

用VHDL写的数字锁相环程序 pll.vhd为源文件 pllTB.vhd为testbench...

📅 2014-01-20

PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), 数字锁相技术在通信领域应用非常广泛，本例用VHDL描述了一个锁相环作为参考，源码已经调试过。编译器synplicty.Fo(Q5)...

📅 2013-12-31

采用atmel的tiny26的pll实现高速pwm，可方便进行电压等的调节。...

📅 2015-04-06

基于s3c24140的arm920t的PLL编程，希望对广大朋友有帮助。...

📅 2015-04-27

Excel spreadsheet allowing calculation of the best R-C-C component values on the PLL Loop Back Filte...

📅 2014-01-14

C51的基于KST-CD111LVD-100 car tuner Driver PLL LC72131 & LA1787 的数字调谐系统...

📅 2014-01-01

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