Ph.D thesis from M.H.Perrott, about Fractional-N PLL design.
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pll技术资料
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PhD.thesis about fractional PLL design from UC san-deago.
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LPC23xx系列ARM时钟源的选择、PLL的设置步骤以及注意事项等。PPT做的非常出色。
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pll 的64倍频 锁相环技术用 实现倍频 从而达到对频率的分频
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驱动时钟加入了PLL,使得DDS的驱动时钟可变.32位的NCO使得DDS的分辨率可以做到Hz量级
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PLL芯片ATF4154控制程序
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verilog PLL的代码
verilog PLL的代码，和PLL 的功能介绍，希望能通过，只是简单了点...
该程序包含一般数字PLL仿真maltab程序和数字COSTAS环程序
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静态pll实验程序
静态pll实验程序，在actel的fusion系列FPGA中综合通过...
pll in verilog in the Appendix
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