这是一个Verilog HDL编写的RISC cpu的程序
这是一个Verilog HDL编写的RISC cpu的程序,该程序共10个子程序,实现了简单的RISC cpu,可供初学者参考,学习硬件描述语言,及设计方法。该程序通过了modelsim仿真验证。...
这是一个Verilog HDL编写的RISC cpu的程序,该程序共10个子程序,实现了简单的RISC cpu,可供初学者参考,学习硬件描述语言,及设计方法。该程序通过了modelsim仿真验证。...
减1计数器 一、设计要求 用Verilog HDL语言设计一个计数器。 要求计数器具有异步置位/复位功能,可以进行自增和自减计数,其计数周期为2^N(N为二进制位数)。 二、设计原理 输入/输出说明:...
这是一个简单易懂的crc计算方法,选择你要计算的文件,准确计算crc值。...
32 bits CRC算法演示,用户可以选择输入一个文件,本工具根据循环雍余校验算法,生成并显示出其32位计算结果。...
我用过的verilog hdl写的SDRAM core源程序,经过测试应用...
crc.cpp是一个产生0-255对应的16位循环冗余码的例子 correlator.cpp是一个相关滤波例子...
本代码是C语言实现的CRC循环校验具体算法...
本程序是在c51的环境下CRC算法的几种方法。希望大家有参考作用。...
Verilog HDL硬件描述语言的教程...
verilog hdl. for igginner. tutorial in word file1 KAMPATE...