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verilog work rom.v verilog work tst.v
Verilog 源代码
VerilogHDL是一种硬件描述语言，以文本形式来描述数字系统硬件的结构和行为的语言，用它可以表示逻辑电路图、逻辑表达式，还可以表示数字逻辑系统所完成的逻辑功能。VerilogHDL和VHDL是世界上最流行的两种硬件描述语言，都是在20世纪80年代中期开发出来的。前者由Gate…
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verilog work aa.vf
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or1k/or1200/rtl/verilog
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verilog work "reg_6bits.v"
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verilog work "div_clk_6hz.v"