This application note provides a functional des cription of VHDL and Verilog source code for a
上传时间： 2013-07-04
上传用户：李梦晗
周立功Verilog精华教程，欢迎下载学习用
标签： Verilog
上传时间： 2013-08-04
上传用户：tedo811
TMS320F28027中文版实验教程,希望初学者能快速 入门^_^
上传时间： 2013-06-16
上传用户：helllovebody
高性能ADC产品的出现，给混合信号测试领域带来前所未有的挑战。并行ADC测试方案实现了多个ADC测试过程的并行化和实时化，减少了单个ADC的平均测试时间，从而降低ADC测试成本。本文实现了基于FPGA的ADC并行测试方法。在阅读相关文献的基础上，总结了常用ADC参数测试方法和测试流程。使用FPGA实现时域参数评估算法和频域参数评估算法，并对2个ADC在不同样本数条件下进行并行测试。 本研究通过在FPGA内部实现ADC测试时域算法和频域算法相结合的方法来搭建测试系统，完成了音频编解码器WM8731L的控制模式接口、音频数据接口、ADC测试时域算法和频域算法的FPGA实现。整个测试系统使用Angilent33220A任意信号发生器提供模拟激励信号，共用一个FPGA内部实现的采样时钟控制模块。并行测试系统将WM8731.L片内的两个独立ADC的串行输出数据分流成左右两通道，并对其进行串并转换。然后对左右两个通道分别配置一个FFT算法模块和时域算法模块，并行地实现了ADC参数的评估算法。在样本数分别为128和4096的实验条件下，对WM8731L片内2个被测.ADC并行地进行参数评估，被测参数包括增益GAIN、偏移量OFFSET、信噪比SNR、信号与噪声谐波失真比SINAD、总谐波失真THD等5个常用参数。实验结果表明，通过在FPGA内配置2个独立的参数计算模块，可并行地实现对2个相同ADC的参数评估，减小单个ADC的平均测试时间。FPGA片内实时评估算法的实现节省了测试样本传输至自动测试机PC端的时间。而且只需将HDL代码多次复制，就可实现多个被测ADC在同一时刻并行地被评估，配置灵活。基于FPGA的ADC并行测试方法易于实现，具有可行性，但由于噪声的影响，测试精度有待进一步提高。该方法可用于自动测试机的混合信号选项卡或测试子系统。
上传时间： 2013-06-07
上传用户：gps6888
这是一款相当不错的VHDL和Verilog转换软件，希望对大家有所帮助。
上传时间： 2013-05-28
上传用户：www240697738
这是一款相当不错的VHDL和Verilog转换软件。希望对大家有所帮助。
上传时间： 2013-06-10
上传用户：aig85
verilog大量源程序，希望对大家有所帮助。。。。。。
上传时间： 2013-06-03
上传用户：ztj182002
·用VC＋＋6．0和MatLAB语言混编开发图像处理实验软件
上传时间： 2013-04-24
上传用户：lingzhichao
【超精华】单片机51实验板设计原理图【超精华】单片机51实验板设计原理图【超精华】单片机51实验板设计原理图【超精华】单片机51实验板设计原理图
上传时间： 2013-04-24
上传用户：mdrd3081
·《手把手教你学单片机的C程序设计》及实验程序作 者：周兴华编著出 版 社：北京航空航天大学出版社出版时间： 2007-10-1字 数： 570000版 次： 1页 数： 345印刷时间： 2007/10/01I S B N ： 9787811242140包 装： 平装内容简介以实践为主线，以生动短小的实例为灵魂，穿插介绍C语言的语法及其针对单片机的特别定义，使理论与实践结合，使读者掌握单
上传时间： 2013-08-01
上传用户：小杨高1
