Verilog+Code
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Content Addressable Memory 的verilog源代码。经过modelsim仿真。
Content Addressable Memory 的verilog源代码。经过modelsim仿真。
2013-12-31
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本原码是基于Verilog HDL语言编写的
本原码是基于Verilog HDL语言编写的,实现了SPI接口设计,可以应用于FPGA,实现SPI协议的接口设计.在MAXII编译成功,用Modelsim SE 6仿真成功.
2015-08-04
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