Verilog+Code
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一个verilog语言描写的同步fifo,包括:Fifo using declared registers for storage和Fifo using (model of) standard memory chip for storage...
2015-12-15
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verilog 编程 有测试文档 基于查表结构实现 离散余弦变换dct 来源：opencores
verilog 编程 有测试文档 基于查表结构实现 离散余弦变换dct 来源：opencores
2013-12-09
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该工程是基于verilog hdl 语言编写的帧传输协议HDLC帧的发送端代码
该工程是基于verilog hdl 语言编写的帧传输协议HDLC帧的发送端代码，会用QUATUSII的人都应该知道如何使用，希望能给你带来帮助
2014-11-22
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