VHDL-AMS 源代码

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VHDL加法器 -- N-bit adder -- The width of the adder is determined by generic N library IEEE; use IEEE.std_logic_1164.all; enti…

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cpu_16.vhdl

library IEEE; library UNISIM; use ieee.std_logic_1164.all; use UNISIM.VComponents.all; entity CPU_16 is port( clk: in s…

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rs232.vhdl

library IEEE; use IEEE.STD_LOGIC_1164.ALL; use IEEE.STD_LOGIC_ARITH.ALL; use IEEE.STD_LOGIC_UNSIGNED.ALL; entity RS232 is …

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