VERILOG
VerilogHDL是一种硬件描述语言，以文本形式来描述数字系统硬件的结构和行为的语言，用它可以表示逻辑电路图、逻辑表达式，还可以表示数字逻辑系统所完成的逻辑功能。VerilogHDL和VHDL是世界上最流行的两种硬件描述语言，都是在20世纪80年代中期开发出来的。前者由GatewayDesignA...
VERILOG 全部资料 3,086 份
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FPGA片内FIFO读写测试Verilog逻辑源码Quartus工程文件+文档说明，使用 FPGA 内部的 FIFO 以及程序对该 FIFO 的数据读写操作。FPGA型号Cyclone4E系列中的EP...
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东南大学Verilog讲义.rar 高级FPGA教学实验指导书－逻辑设计部分.pdf ...
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Synopsys的DesignWare库中采用的brentkung高速加法器Verilog源代码生成,附相关文档
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详尽介绍了VERILOG编程过程中的组合逻辑和时序逻辑设计方法
详尽介绍了VERILOG编程过程中的组合逻辑和时序逻辑设计方法，同时对仿真程序的编程和使用也做了完美的讲解，便于快速学习掌握...