译码器设计
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功能非常完善的MP3编译码器
·详细说明：功能非常完善的MP3编译码器,输入文件WAV或AIFF,能够方便的嵌入到你自己的系统当中.- Function extremely perfect MP3 arranges the dec...
可配置的Viterbi译码器的FPGA实现.rar
卷积码作为一类重要的前向纠错码，同具有最大似然译码特性的Viterbi译码算法，广泛应用于各种数字通信系统。随着通信技术的持续发展，产生了许多新技术和新标准。不同的通信标准采用不同的卷积码，以往固定参...
集成编、译码器在水位检测中的应用
本文将水的导电特性与集成编、译码技术结合讨论了集成编、译码器MC145026、MC145028 在水位数字化检测领域中的应用原理。对该系统的结构、特点和工作原理作了较详细的介绍。关键词：编码器...
74155 TTL图腾柱输出译码器、分配器
These TTL circuits feature dual 1-line-to-4-line demultiplexerswith individual strobes and commo...
基于DVD应用的RS编译码器的研究
纠错码技术是一种通过增加一定冗余信息来提高信息传输可靠性的有效方法。RS码是一种典型的纠错码，在线性分组码中，它具有最强的纠错能力，既能纠正随机错误，也能纠正突发错误，在深空通信、移动通信、磁盘阵列、...
基带芯片中Viterbi译码器的研究与实现
基于对传统Viterbi 译码器的分析和对改进的Viterbi 算法理论的修正，提出了一种新的Viterbi 译码器的实现方法。通过对路径度量值的深入分析和对回溯信息的重新编码，在不增加硬件实...
迭代思想的复数旋转码FPGA编译码器
编译码是数字通信系统中一个十分重要的环节，它的性能直接决定了一个数字通信系统性能的优劣。长期以来人们一直在探索更加简便、可靠、数据冗余度低的编译码方法，尤其是在海量存储与高速数据传输应用中。 本文工作...
IEEE 802.16e中LDPC译码器的实现
面向IEEE 802.16e 中 LDPC 码，分析了各种译码算法的译码性能，归一化最小（NMS）算法具备较高译码性能和实现复杂度低的特点。提出一种基于部分并行方式的LDPC 译码器结构，可以满足IE...
RS级联译码器并行帧同步算法及实现
针对卷积-RS 码级联译码器中的帧同步问题，提出了一种高速并行结构。该结构采用符号域同步算法替代传统的比特 域同步算法，克服了传统级联译码器中帧同步器的速率瓶颈。该算法使用多路并行相关，再由状态机根...