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全并行Viterbi译码器的FPGA实现
本文对于全并行Viterbi译码器的设计及其FPGA实现方案进行了研究，并最终将用FPGA实现的译码器嵌入到某数字通信系统之中。 首先介绍了卷积码及Viterbi译码算法的基本原理，并对卷积码的...
译码器设计
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74154 TTL 4线—16线译码器
Each or these 4-line-to-16-line decoders utilizes TTL circuitryto decode four binary-coded input...
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纯整数LOGMAPTurbo编译码器FPGA实现
在通信系统中，由于信道噪声的存在使得传输的信号发生改变，从而在接收端发生错误。因此差错控制作为提高传输可靠性的关键技术，已成为通信领域多年来的研究热点。1993年C.Berrou等人提出的Turbo码...
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卷积Turbo码编译码器FPGA实现
卷积Turbo码因其优异的纠错性能越来越受人门的关注，而编码器和译码器是编码理论实际应用的重点和难点。论文根据IEEE802.16e标准，以低时延、高吞吐量、支持高时钟频率、参数可配置为目标，对卷积T...
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FPGA例程之3_8译码器
本资源提供了一个高质量的FPGA例程，专注于3-8译码器的设计与实现。对于正在学习或从事数字电路设计、特别是FPGA开发领域的工程师来说，这是一个非常实用的学习材料。通过研究此例程，您可以深入了解如何...
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卷积码编译码器前段时间在学校做通信系统课程设计
卷积码编译码器前段时间在学校做通信系统课程设计，选了信道卷积码编译码的课题，但在网上搜遍了也没找到它的MatLab实现，没办法，我只好在图书馆查资料自己解决了。这就是我课程设计论文的论证部分：...
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基于ARM嵌入式应用平台的x86指令译码器设计
传统的计算机软件与下层的机器平台有着强烈的依赖关系，针对一个机器平台编译的程序不能运行在其他平台上。随着新的体系结构和操作系统的不断涌现，对计算机系统间的互操作性要求也越来越高。二进制翻译技术可以将一...