基于vhdl 的数字频率计的设计源程序及工程文件
基于vhdl 的数字频率计的设计源程序及工程文件,已在实验箱上实现...
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基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计,并在EDA(电子设计自动化) 工具的帮助下,用大规模可编程逻辑器件(FPGA/ CPLD) 实现数字频率计的设计原理及相关程序...
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