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任意奇数分频，只要修改N即可实现可验证...

📅 2014-01-20

16c54四位LED时钟显示程序使用4M晶振TMR0滪分频为1：16 TMRO的循环时间为4.096MS 244次为一秒...

📅 2013-12-04

用VERILOG HDL实现的任意频率分频器源代码，是一个通用的程序...

📅 2014-01-07

0到255任意整数半整数分频Verilog HDL.rar...

📅 2014-12-20

本文使用实例描述了在 FPGA/CPLD 上使用 VHDL 进行分频器设计，包括偶数分频、非 50％占空比和 50％占空比的奇数分频、半整数（N+0.5）分频、小数分频、分数分频以及积分分频。...

📅 2013-12-15

数控分频的一个工程---包括vhdl源程序和编译后产生的相关文件...

📅 2016-10-04

实现任意小数分频的VHDL源代码，方便，快捷，提供丰富的资料可供参考，希望大家喜欢...

📅 2014-01-25

数控分频器的设计数控分频器的功能就是当在输入端给定不同输入数据时，将对输入的时钟信号有不同的分频比，数控分频器就是用计数值可并行预置的加法计数器设计完成的，方法是将计数溢出位与预置数加载输入信号相接即...

📅 2016-10-13

应用VHDL语言将高稳晶振分频得到1pps，使用GPS的1pps信号作为触发...

📅 2016-10-15

偶数分频，包括验证程序，verilog实现，可综合...

📅 2014-01-03

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