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VHDL分频器，利用分频比较错法，要实现K=324/28=8.3571428571...的分频周期为28，18个8分频和10个9分频循环，所以设一个０到２7的循环计数器，每当1、4、7、10、13、1...

📅 2013-11-29

用以实现信号的任意分频，用于信号的精确分频...

📅 2016-05-31

用vhdl实现的分频器，可产生任意对主时钟的分频，从而是实现不同频率pwm的控制...

📅 2016-06-01

BCSCTL1 = 0X00 //将寄存器的内容清零 XT2震荡器开启 LFTX1工作在低ACLK的分频因子为1...

📅 2014-01-22

分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太...

📅 2016-06-14

本源码已通过调试,里面有简单的分频做法和点亮18个LED灯...

📅 2016-06-24

vhdl3分频功能看名字就知道了，还用多说什么吗，大家都是聪明人...

📅 2014-01-05

电子琴VHDL程序包含有：顶层程序、音阶发生器程序、数控分频模块程序和自动演奏模块程序...

📅 2013-12-20

一个可实现多倍（次）分频器VHDL源代码设计...

📅 2014-01-27

一个基于CPLD/FPGA的半整数分频器的设计的文档资料...

📅 2016-07-13

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