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顶好用的四倍频芯片，可实现四细分、辨向、可逆计数及缓存功能。...

📅 2017-05-25

半整数分频器的实现（verilog），本文以6.5分频为例！很实用的！...

📅 2014-08-20

此为EDA设计的分频器模块。可以实现三种不同的频率信号，可以通过使用者自由设置频率大小...

📅 2013-12-22

分频器的vhdl描述，在源代码中完成对时钟信号CLK的2分频,4分频,8分频,16分频...

📅 2014-01-16

数控分频器的输出信号频率为输入数据的函数。用传统的方法设计,其设计过程和电路都比较复杂,且设计成果的可修改性和可移植性都较差。基于VHDL 的数控分频器设计,整个过程简单、快捷,极易修改,可移植性...

📅 2014-11-29

verilog实现的奇数分频器针对任何规模的奇数分频...

📅 2017-06-19

分别用分频比交错法及累加器分频法完成非整数分频器设计。...

📅 2014-01-01

用FPGA仿真实现数控分频器，完整的工程文件...

📅 2014-06-18

此文件为EDA的8位分频器，但可以用于不同位分频器，如：1位到10位等，用Quartus软件来，以文件VHD格式编译即可...

📅 2013-12-25

基于Quartus II的数控分频器的项目设计，实现对时钟信号的任意进制分频，包含了项目文件和VHDL源代码...

📅 2017-07-18

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