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可实现快速锁定的FPGA片内延时锁相环设计
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位置环设计
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应用于十万门FPGA的全数字锁相环设计
在过去的十几年间，FPGA取得了惊人的发展：集成度已达到1000万等效门、速度可达到400～500MHz。随着FPGA的集成度不断增大，在高密度FPGA中，芯片上时钟的分布质量就变得越来越重要。时钟延时和时钟相位偏移已成为影响系统性能的重要...
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基于环网的多DSP系统的并行算法的设计
· 摘要： 在基于环网的多DSP系统上，应用并行块处理的策略讨论了并行算法设计的调度模型；对可100%利用的DSP 数目及调度模型的2个关键参数：块处理的时间和DSP间的延迟时间进行了具体的分析；将DSP上的处理过程和...