📚 交织器 vhdl技术资料

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VHDL分频器，利用分频比较错法，要实现K=324/28=8.3571428571...的分频周期为28，18个8分频和10个9分频循环，所以设一个０到２7的循环计数器，每当1、4、7、10、13、1...

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用vhdl实现的分频器，可产生任意对主时钟的分频，从而是实现不同频率pwm的控制...

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用VHDL编写的一个出租车计费器，起步6元计2公里，此后每半公里计0.8元，停车等待每2.5分计0.8元。通过仿真，但未下载到CPLD测试...

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