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用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块....

📅 2016-06-04

简述了V HDL 语言的功能及其特点,并以 8 位串行数字锁设计为例,介绍了在Max + plus Ⅱ10. 2 开发软件下,利用V HDL 硬件描述语言设计数字逻辑电路的过程和方法。并设计了密...

📅 2013-12-23

操作系统关于处理死锁的课件，我们上课用的。做的很好...

📅 2013-12-21

数字抢答器由主体电路与扩展电路组成。优先编码电路、锁存器、译码电路将参赛队的输入信号在显示器上输出；用控制电路和主持人开关启动报警电路，以上两部分组成主体电路。通过定时电路和译码电路将秒脉冲产生的信号...

📅 2016-06-10

在总结前人提出的一些锁相环仿真模型的基础上，用Matlab语言构建了一种新的适用于全数字仿真模型。...

📅 2016-06-13

分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL，Xilinx的DLL)来进行时钟的分频、倍频以及相移设计，但是，对于时钟要求不太...

📅 2016-06-14

一阶全数字锁相环VERLOGIC程序代码，调试通过。...

📅 2013-12-15

介绍了数字锁相环的3种设计方法，并对各自的工作原理做了详细分析。...

📅 2014-01-20

微分器：利用数字锁相环进行位同步信号提取的关键模块...

📅 2014-09-10

摘　要: 数字密码锁主要完成上锁、密码输入、密码核对、开启电锁、密码修改等功能.数字密码锁的设计电路主要包括 11 个模块 ,各模块由相应的 VHDL 程序具体实现并分别进行了 MAX + PLUS ...

📅 2016-06-22

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