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https://www.eeworm.com/dl/684/306690.html 软件设计/软件工程

White paper - Comparison of VHDL, Verilog and SystemVerilog Good for one interetsted in using n of

White paper - Comparison of VHDL, Verilog and SystemVerilog Good for one interetsted in using n of VHDL, Verilog and SystemVerilog languages
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https://www.eeworm.com/dl/663/309739.html VHDL/FPGA/Verilog

用vhdl编写的FFT的代码,很全,很强大.

用vhdl编写的FFT的代码,很全,很强大.
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https://www.eeworm.com/dl/663/309921.html VHDL/FPGA/Verilog

用VHDL语言在FPGA上实现浮点运算,大家共享

用VHDL语言在FPGA上实现浮点运算,大家共享
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https://www.eeworm.com/dl/663/310654.html VHDL/FPGA/Verilog

基于VHDL的SDH专用芯片的TOP-DOWN设计

基于VHDL的SDH专用芯片的TOP-DOWN设计， 内有全套源码以及图片，内容详尽，绝对真实可靠！
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https://www.eeworm.com/dl/663/311364.html VHDL/FPGA/Verilog

VHDL设计的ds18b20的测温程序

VHDL设计的ds18b20的测温程序，欢迎测试请不要直接复制，可能不好显示。
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https://www.eeworm.com/dl/663/313017.html VHDL/FPGA/Verilog

可以调整时间和设置闹钟的数字钟(VHDL)

可以调整时间和设置闹钟的数字钟(VHDL)
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https://www.eeworm.com/dl/663/313291.html VHDL/FPGA/Verilog

基于vhdl的rom的描述,经过确定测试通过.

基于vhdl的rom的描述,经过确定测试通过.
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https://www.eeworm.com/dl/663/317658.html VHDL/FPGA/Verilog

用VHDL书写的DDS程序 里面有详细的注解

用VHDL书写的DDS程序 里面有详细的注解
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https://www.eeworm.com/dl/663/325848.html VHDL/FPGA/Verilog

这是分别用vhdl和verilog语言编写的源程序

这是分别用vhdl和verilog语言编写的源程序，里边还附上了生成的电路器件图。
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https://www.eeworm.com/dl/663/328695.html VHDL/FPGA/Verilog

大量VHDL写的数字系统设计有用实例达到

大量VHDL写的数字系统设计有用实例达到
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