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VHDL/FPGA/Verilog 一个可综合的同步FIFO的verilog源代码

一个可综合的同步FIFO的verilog源代码

https://www.eeworm.com/dl/663/233475.html

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verilog FIFO 源代码

串口编程  UART_verilog,自己设计的异步串行收发。包括测试文件。

UART_verilog,自己设计的异步串行收发。包括测试文件。

https://www.eeworm.com/dl/624/234268.html

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UART_verilog 异步串行收发测试

数学计算  一个超前进位加法器的Verilog实现

一个超前进位加法器的Verilog实现，内含测试文件，可以综合，非常有参考价值

https://www.eeworm.com/dl/641/236762.html

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Verilog 进位加法器

VHDL/FPGA/Verilog 用verilog语言实现DCT编解码附有DCT的说明

用verilog语言实现DCT编解码附有DCT的说明

https://www.eeworm.com/dl/663/237345.html

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DCT verilog 语言编解码

VHDL/FPGA/Verilog 本文件中包含了多个verilog实现的实用小程序

本文件中包含了多个verilog实现的实用小程序，帮助初学者学习verilog语言。

https://www.eeworm.com/dl/663/243541.html

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verilog 程序

VHDL/FPGA/Verilog CAN_IPCore CAN协议的IP核源代码 verilog 语言

CAN_IPCore CAN协议的IP核源代码 verilog 语言

https://www.eeworm.com/dl/663/243597.html

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CAN_IPCore verilog CAN 协议

其他嵌入式/单片机内容  采用Verilog语言描述的FIFO和双端口RAM源代码。

采用Verilog语言描述的FIFO和双端口RAM源代码。

https://www.eeworm.com/dl/687/243992.html

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Verilog FIFO RAM 语言

VHDL/FPGA/Verilog 將VHDL設計轉換成Verilog設計的程式

將VHDL設計轉換成Verilog設計的程式

https://www.eeworm.com/dl/663/248072.html

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Verilog VHDL 程式

VHDL/FPGA/Verilog 自己编写的串口UART发送的Verilog模块。与FIFO连接

自己编写的串口UART发送的Verilog模块。与FIFO连接，可以实现自动连续发送。

https://www.eeworm.com/dl/663/251468.html

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Verilog UART FIFO 编写

VHDL/FPGA/Verilog 一个用verilog语言实现的包含：键盘扫描

一个用verilog语言实现的包含：键盘扫描，led驱动、vga视频输出的例子。功能为用键盘控制一个方块的显示位置。需要有fpga板子支持。

https://www.eeworm.com/dl/663/256394.html

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