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VHDL/FPGA/Verilog cycloneII Quartus verilog开发的简单时序电路

cycloneII Quartus verilog开发的简单时序电路
https://www.eeworm.com/dl/663/457872.html
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VHDL/FPGA/Verilog 基于verilog的booth算法的乘法器

基于verilog的booth算法的乘法器
https://www.eeworm.com/dl/663/465513.html
下载: 150
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VHDL/FPGA/Verilog 用verilog HDL编写的并串转换模块

用verilog HDL编写的并串转换模块，在ISE软件仿真过，也可综合
https://www.eeworm.com/dl/663/467061.html
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其他 jtag TAP控制状态机代码 verilog VHDL

jtag TAP控制状态机代码 verilog VHDL
https://www.eeworm.com/dl/534/467136.html
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VHDL/FPGA/Verilog verilog编写的16qam调制程序

verilog编写的16qam调制程序，将所有东西装入工程，运行mmm16主程序。其中载波为一个周期采十个点，并乘以2^8-1取整数。在quartusII运行通过。
https://www.eeworm.com/dl/663/470152.html
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软件设计/软件工程 is a test of a verilog implementation to do a oscilloscope with dual-port RAM

is a test of a verilog implementation to do a oscilloscope with dual-port RAM
https://www.eeworm.com/dl/684/473703.html
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VHDL/FPGA/Verilog Fir verilog code implemented to find out the output of fir filter

Fir verilog code implemented to find out the output of fir filter
https://www.eeworm.com/dl/663/474641.html
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数值算法/人工智能 verilog语言实在点变换DFT源代码

verilog语言实在点变换DFT源代码，可以配合软核或者其他CPU进行综合FFT变换，也可以单独使用生成module！
https://www.eeworm.com/dl/518/475869.html
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VHDL/FPGA/Verilog code for fpga is written in verilog,cardinality is a thing which is very important

code for fpga is written in verilog,cardinality is a thing which is very important
https://www.eeworm.com/dl/663/478111.html
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VHDL/FPGA/Verilog 本文是卡内基梅隆大学的verilog讲义

本文是卡内基梅隆大学的verilog讲义，写作的角度与中文教材的角度有所不同，看了后会有一定的收获和进步。
https://www.eeworm.com/dl/663/478432.html
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