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VHDL/FPGA/Verilog 这是一组Verilog的代码小程序

这是一组Verilog的代码小程序，适合新手练习使用．

https://www.eeworm.com/dl/663/186039.html

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Verilog 代码程序

VHDL/FPGA/Verilog 用verilog编写的fir滤波器程序

用verilog编写的fir滤波器程序，开发环境可以用ise quartus或active hdl等

https://www.eeworm.com/dl/663/187035.html

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verilog fir 编写滤波器

VHDL/FPGA/Verilog 用Verilog语言实现信号发生器

用Verilog语言实现信号发生器，包括AM，FM,PM，ASK,PSK,FSK调制。

https://www.eeworm.com/dl/663/193383.html

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Verilog 语言信号发生器

VHDL/FPGA/Verilog ddr2 controller, verilog source code from xilinx

ddr2 controller, verilog source code from xilinx

https://www.eeworm.com/dl/663/194343.html

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controller verilog source xilinx

VHDL/FPGA/Verilog 基本运算逻辑和它们的Verilog HDL模型

基本运算逻辑和它们的Verilog HDL模型

https://www.eeworm.com/dl/663/198088.html

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Verilog HDL 运算模型

其他书籍  verilog硬件描述语言介绍,仅供学习之用

verilog硬件描述语言介绍,仅供学习之用

https://www.eeworm.com/dl/542/203802.html

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verilog 硬件描述语言

VHDL/FPGA/Verilog Verilog HDL: Magnitude For a vector (a,b), the magnitude representation is the following: A c

Verilog HDL: Magnitude For a vector (a,b), the magnitude representation is the following: A common approach to implementing these arithmetic functions is to use the Coordinate Rotation Digital Computer (CORDIC) algorithm. The CORDIC algorithm calculates the trigonometric functions of sine, cosine ...

https://www.eeworm.com/dl/663/212701.html

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representation Magnitude the magnitude

VHDL/FPGA/Verilog 基于Verilog的数码管模拟扫描程序

基于Verilog的数码管模拟扫描程序，分为两种显示方式，一种是数码管逐个显示，另一个是所有数码管一起显示。

https://www.eeworm.com/dl/663/223927.html

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Verilog 数码管扫描程序模拟

VHDL/FPGA/Verilog verilog HDL编写的出租车计费系统

verilog HDL编写的出租车计费系统

https://www.eeworm.com/dl/663/224217.html

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verilog HDL 编写出租车计费系统

VHDL/FPGA/Verilog ALTERA关于CCD的一些verilog程序

ALTERA关于CCD的一些verilog程序，都通过运行无误的。

https://www.eeworm.com/dl/663/229200.html

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verilog ALTERA CCD 程序

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