搜索：verilog hdl 是什么？

技术资料  《利用python进行数据分析（第2版）》高清版 21.6M 549页

本书讲的是利用Python进行数据控制、处理、整理、分析等方面的具体细节和基本要点。我的目标是介绍Python编程和用于数据处理的库和工具环境，掌握这些，可以让你成为一个数据分析专家。虽然本书的标题是“数据分析”，重点却是Python编程、库，以及用于数据分析的工具。这就是数据分析要用到的Python编程。什么样的数据？当 ...

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python 数据分析

技术资料  Arduino和串口数据实时图形软件SerialChart

Arduino和SerialChart的互动SerialChart是什么?SerialChart是一个体积非常小串口数据实时生成图形的软件，作用就是绘图，那么在哪些场合可以用上呢?做平衡小车的PID调试，还有卡尔曼滤波融合的时候，借助这个简单的小工具有一个能把数据实时传回电脑进行分析，并且生成图形的软件，会对调试过程起到事半功倍的效果。正因为S ...

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arduino 串口 serialchart

DSP编程  基于DSP Builder数字信号处理器的FPGA设计

针对使用硬件描述语言进行设计存在的问题，提出一种基于FPGA并采用DSP Builder作为设计工具的数字信号处理器设计方法。并按照Matlab/Simulink/DSP Builder/QuartusⅡ设计流程，设计了一个12阶FIR 低通数字滤波器，通过Quartus 时序仿真及嵌入式逻辑分析仪SignalTapⅡ硬件测试对设计进行了验证。结果表明，所设计的FIR 滤波 ...

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Builder FPGA DSP 数字信号处理器

技术资料  EoS中虚级联及LCAS功能的芯片设计与FPGA实现.rar

随着Internet技术的持续发展和宽带接入网建设的不断深入，数据业务流量飞速增长，已经成为电信市场的主体之一。但是，纯IP网络尚达不到公用传输网的可靠性要求，且建设耗资巨大。因此，人们提出基于同步数字体系（SDH）下传输以太网数据（Ethernet over SDH-EoS）的解决方案，被业界称之为EoS技术。EoS技术的出现，较好的实 ...

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LCAS FPGA

技术资料  基于FPGA的80211b设计.rar

基于WiFi 技术的无线局域网是现代无线通信技术在计算机网络中的典型应用，具有可移动性、安装方便、成本低、扩展能力强等优点。其所采用的核心技术是IEEE802.11b通信协议，带宽最高可达11Mbps。802.11b协议基于DSSS无线频率调制技术，有较强的抗干能力，被选为该标准的唯一的物理传输技术，使得802.11b可以和1Mbps和2Mbps的 ...

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80211b FPGA

技术资料  数字信号处理的FPGA实现中文版刘凌

FPGA正在掀起一场数字信号处理的变革。本书旨在讲解前端数字信号处理算法的高效实现。首先概述了当前的FPGA技术、器件以及用于设计最先进DSP系统的工具。第1章的案例研究是40多个设计示例的基础。随后几章阐述了计算机算法的概念、理论、FIR和IIR滤波器的实现、多抽样率数字信号系统、DFT和FFT算法、未来很可能实现的高级算 ...

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数字信号处理 fpga

学术论文  基于FPGA的DES加密系统设计与实现

本文设计实现了一种基于FPGA的DES加密系统。概括起来，本文主要完成了以下几方面的主要工作：完成了DES加密系统的整体设计。整个系统包括DES加密核心模块，UART通信接口模块和BLOCKRAM存储模块。以EITS2003开发板为硬件开发平台，ISEwebpack为开发软件，用Verilog硬件描述语言设计并且实现了三大模块的具体功能及整体连接 ...

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FPGA DES 加密系统设计

教程资料  最重要的是七个从简单到复杂的实验

最重要的是七个从简单到复杂的实验，包括：基础实验一_FPGA_LED 基础实验二_seg7实验以及仿真基础实验三_SOPC_LED 基础实验四_Flash烧写基础实验五_定时器实验基础实验六_按键以及PIO口中断实验实验七_网卡使用，这些实验室用到了SOPC BUILDER 与NOIS ii ,使用Verilog 编写，有实验板和没有实验板的都可以用来学习。 ...

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实验

无线通信  基于FPGA的VGA接口显示技术

基于Quartus Ⅱ开发软件，运用verilog 语言，在FPGA 实现VGA 的显示。基于这种设计方法，可以在不使用VGA 显示卡和计算机的情况下，实现VGA 图像的显示和控制。系统具有成本低、结构简单、应用灵活的优点，可广泛应用于超市、车站、飞机场等公共场所的广告宣传和提示信息显示，也可应用于工厂车间生产过程中的操作信息显 ...

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FPGA VGA 接口显示技术

VHDL/FPGA/Verilog Hard-decision decoding scheme Codeword length (n) : 31 symbols. Message length (k) : 19 symbols.

Hard-decision decoding scheme Codeword length (n) : 31 symbols. Message length (k) : 19 symbols. Error correction capability (t) : 6 symbols One symbol represents 5 bit. Uses GF(2^5) with primitive polynomial p(x) = X^5 X^2 + 1 Generator polynomial, g(x) = a^15 a^21*X + a^6*X^2 + a^15*X^3 + a^ ...

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symbols length Hard-decision Codeword

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